实验三：数据选择器、译码器、全加器实验

数据选择器、译码器、全加器实验

一、实验目的

1、熟悉数据选择器的功能。

2、熟悉译码器的工作原理和使用方法。

3、设计应用译码器，进一步加深对它的理解。

4、学习用中规模集成电路的设计方法。

二、实验所用仪器和芯片

1、双4选1数据选择器      74LS153               1片

2、双2线-4线译码器         74LS139               2片

3、四两输入与非门       74LS00         1片

3、TEC-5(TDS-2)实验系统                       1台

三、实验内容

1、用Quartus II设计一个4选1的数据选择器

4个输入端输入4组周期不同的信号，改变数据选择引脚的电平和使能端（低电平有效）的电平，产生四种不同的组合，观察每种组合下数据选择器的的输出信号情况；

2、用2线-4线译码器设计一个3线-8线译码器，框图如下：

3、用数据选择器（1片74LS153）设计实现一位全加器，实现电路并验证其正确性。

附74LS153和74LS139管脚图

                                                                   

                输入                                    输入       输出

 

Vcc G₂   A₁  2D₃ 2D₂ 2D₁ 2D₀  2Y      输出      Vcc G₂   A₁  B₂  2Y₀ 2Y₁ 2Y₂ 2Y₃

G₁   A₀  1D₃ 1D₂ 1D₁ 1D₀  1Y GND                G₁  A₁   B₁  1Y₀ 1Y₁ 1Y₂ 1Y₃ GND

                                                                            

            输入      输出                         输入        输出

第二篇：实验二 数据选择器 译码器 全加器实验

实验二  数据选择器  译码器  全加器实验

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