数字钟设计报告
学生姓名：
学 号：
专业班级：
目 录
一、 绪 论
1.1 课程认知
数字钟是采用数字电路实现对时、分、秒，数字显示的计时装置。早已成为人们日常生活中不可少的必需品，给人们的生活、学习、工作、娱乐带来极大的方便。由于数字集成电路技术的发展，数字钟的设计已经是个课程的基础。由电子电路实现一个自动数字钟，完成秒分时自动调节及其相关功能，加强学生手动实践能力成为合适首选的方案之一。
数字钟是现代计时器，也可用作时间控制的时钟源。数字钟由于其具有走时准，显示直观，款式新颖，附加功能多等优点而受到人们的欢迎。设计一个具有整点报时，可对时的数字钟 。由于数字集成电路的发展和石英晶体振荡器的广泛应用,使得数字钟的精度,远远超过老式钟表, 钟表的数字化给人们生产生活带来了极大的方便，而且大大地扩展了钟表原先的报时功能。如闹铃、按时自动打铃、等，所有这些，都是以钟表数字化为基础的。因此，研究数字钟及扩大其应用，有着非常现实的意义。
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数字电子钟课程设计报告
题目：数字电子钟的设计与仿真
专业：机械工程
加入世贸组织以后，中国会面临激烈的竞争。这种竞争将是一场科技实力、管理水平和人才素质的较量，风险和机遇共存，同时电子产品的研发日新月异，不仅是在通信技术方面数字化取代于模拟信号，就连我们的日常生活也进于让数字化取缔。说明数字时代已经到来，而且渗透于我们生活的方方面面。
就拿我们生活的实例来说明一下“数字”给我们带来的便捷。下面我们就以数字钟为例简单介绍一下。数字钟我们听到这几个字，第一反应就是我们所说的数字，不错数字钟就是以数字显示取代模拟表盘的钟表，在显示上它用数字反应出此时的时间，相比模拟钟能给人一种一目了然的感觉，不仅如此它还能同时显示时、分、秒。而且能对时、分、秒准确校时，这是普通钟所不及的。与此同时数字钟还能准确定时，在你所规定的时间里准确无误的想你发出报时声音，提醒你在此时所需要去做的事。与旧式钟表相比它更适用于现代人的生活。
在毕业之际恰好遇上学校的毕业课题电子时钟设计毕业论文。因而在所学专业的基础上做了以下毕业设计。希望给大家带来方便的同时，使自己对所学专业有进一步的了解！
目录
前言................................................................................................................................. 1
一．摘要.......................................................................................................................... 1
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数字时钟课程设计 第 1 页 共 19 页
数字时钟课程设计
目录
一、引言 ?????????????????????????????2
二．设计指标 ???????????????????????????2
1．指标要求??????????????????????????2
2．设计要求??????????????????????????2
三．原理设计 ???????????????????????????3
1．总体方案设计????????????????????????3
2．单元电路设计????????????????????????4
1)时间计数单元 ???????????????????????4
2)时间计数单元 ???????????????????????6
3)校时控制电路单元 ?????????????????????7
4) 555定时振荡电路 ?????????????????????7
5）整点报时电路???????????????????????8
3．总体电路??????????????????????????10
四．仿真调试 ???????????????????????????10
五．调试及制作 ??????????????????????????11
1．检查电路??????????????????????????11
2.数码管引脚对应的电位图???????????????????12
3.按功能模块分别调试?????????????????????12
六．总结 ?????????????????????????????13 附录 ???????????????????????????????15 参考文献 ?????????????????????????????18
数字时钟课程设计
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物理与电气工程学院课程实践报告
数字钟
姓 名：
学 号：111102051
专 业：电信
指导老师：
成 绩：
日 期：
基于51单片机的数字钟
一、前言
数字钟是采用数字电路实现对时、分、秒，数字显示的计时装置。早已成为人们日常生活中不可少的必需品，给人们的生活、学习、工作、娱乐带来极大的方便。由于数字集成电路技术的发展，数字钟的设计已经是个课程的基础。由电子电路实现一个自动数字钟，完成秒分时自动调节及其相关功能，加强学生手动实践能力成为合适首选的方案之一。
数字钟是现代计时器，也可用作时间控制的时钟源。数字钟由于其具有走时准，显示直观，款式新颖，附加功能多等优点而受到人们的欢迎。设计一个具有整点报时，可对时的数字钟 。由于数字集成电路的发展和石英晶体振荡器的广泛应用,使得数字钟的精度,远远超过老式钟表, 钟表的数字化给人们生产生活带来了极大的方便，而且大大地扩展了钟表原先的报时功能。如闹铃、按时自动打铃、等，所有这些，都是以钟表数字化为基础的。因此，研究数字钟及扩大其应用，有着非常现实的意义。
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VHDL数字钟设计报告
一. 数字钟总体设计方案：
1.1设计目的
①正确显示时、分、秒；
②可手动校时，能分别进行时、分的校正；
③整点报时功能；
1.2设计思路
数字钟的设计模块包括：分频器、去抖动电路、校时电路、“时、分、秒”计数器、校时闪烁电路、整点报时和译码显示电路。
每一个功能模块作为一个实体单独进行设计，最后再用VHDL的例化语句将各个模块进行整合，生成顶层实体top。
该数字钟可以实现3个功能：计时功能、设置时间功能和报时功能。
二．数字钟模块细节
2.1 分频器（fenpin）
本系统共需3种频率时钟信号（1024Hz、512Hz、1Hz）。为减少输入引脚，本系统采用分频模块，只需由外部提供1024Hz基准时钟信号，其余三种频率时钟信号由分频模块得到。
分频原理：为以1024Hz基准时钟经1024分频得到512Hz,1Hz频率时钟信号。
分频器管脚
代码：
library ieee;
use ieee.std_logic_1164.all;
use ieee.std_logic_unsigned.all;
use ieee.std_logic_arith.all;
entity fenpin is
port(clk1024:in std_logic;
clk1,clk512:out std_logic
);
end fenpin ;
architecture cml of fenpin is
begin
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数字钟设计报告
学生姓名：
学 号：
专业班级：
目 录
一、 绪 论
1.1 课程认知
数字钟是采用数字电路实现对时、分、秒，数字显示的计时装置。早已成为人们日常生活中不可少的必需品，给人们的生活、学习、工作、娱乐带来极大的方便。由于数字集成电路技术的发展，数字钟的设计已经是个课程的基础。由电子电路实现一个自动数字钟，完成秒分时自动调节及其相关功能，加强学生手动实践能力成为合适首选的方案之一。
数字钟是现代计时器，也可用作时间控制的时钟源。数字钟由于其具有走时准，显示直观，款式新颖，附加功能多等优点而受到人们的欢迎。设计一个具有整点报时，可对时的数字钟 。由于数字集成电路的发展和石英晶体振荡器的广泛应用,使得数字钟的精度,远远超过老式钟表, 钟表的数字化给人们生产生活带来了极大的方便，而且大大地扩展了钟表原先的报时功能。如闹铃、按时自动打铃、等，所有这些，都是以钟表数字化为基础的。因此，研究数字钟及扩大其应用，有着非常现实的意义。
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数电课程设计报告
1、前言。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。2
2、设计任务。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。2
3、方案论证。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。3
4、系统结构。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。4
4.1系统结构框图。。。。。。。。。。。。。。。。。。。。。。。4
4.2系统各方框图的作用。。。。。。。。。。。。。。。。。5
5、整机电路设计。。。。。。。。。。。。。。。。。。。。。。。。。。6
5.1总电路图。。。。。。。。。。。。。。。。。。。。。。。。。。。6
5.2芯片管脚图。。。。。。。。。。。。。。。。。。。。。。。。。6
5.3整机电路元器件表。。。。。。。。。。。。。。。。。。。7
6、整机电路调试。。。。。。。。。。。。。。。。。。。。。。。。。。8
6.1调试步骤。。。。。。。。。。。。。。。。。。。。。。。。。。。8
6.2调试中发现的问题与解决办法。。。。。。。。。9
7、参考文献。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。9
8、心得体会。。。。。。。。。。。。。。。。。。。。。。。。。。。。。10
一、前言
数字钟是一种用数字电路技术实现时、分、秒计时的装置，与机械式时钟相比具有更高的准确性和直观性，且无机械装置，具有更更长的使用寿命，因此得到了广泛的使用。
数字钟从原理上讲是一种典型的数字电路，其中包括了组合逻辑电路和时序电路。目前，数字钟的功能越来越强，并且有多种专门的大规模集成电路可供选择。数字钟适用于自动打铃、自动广播，也适用于节电、节水及自动控制多路电器设备。它是由数子钟电路、定时电路、放大执行电路、电源电路组成。为了简化电路结构，数字钟电路与定时电路之间的连接采用直接译码技术。具有电路结构简单、动作可靠、使用寿命长、更改设定时间容易、制造成本低等优点。
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一、设计任务
设计一台能显示时、分、秒的数字钟。具体要求如下：
（1） 由实验箱上的时钟信号经分频产生秒脉冲；
（2） 计时计数器用24进制计时电路；
（3） 可手动校时，能分别进行时、分的校正；
（4） 整点报时；
二、 试验目的
（1） 掌握时十进制、六进制和二十四进制计数器的设计方法。
（2） 掌握多位计数器相连的设计方法。
（3） 掌握多位共阴极扫描显示数码管的驱动及编码。
三、总体设计方案
本数字系统实现数字钟的基本的计时功能，输入8Hz的时钟，通过分频产生1Hz的时钟信号，采用24/12小时制计时，能显示时、分、秒。本系统还具有校正功能，可以进行时分的校时，当计时器运行到59分59秒开始报时，另外还可以设定闹钟，当按下闹铃开关时，可在规定时间闹铃，当开关复位时，闹铃停止。
本数字钟实际上是一个对频率(1Hz)进行计数的计数电路。由于计数的起始时间不可能与标准时间一致，故需要在电路上加一个校时电路，同时分频后的1Hz时间信号必须做到准确稳定。通常使用石英晶体振荡器电路构成数字钟。
数字钟的基本组成
本数字钟的实现可分为以下几个模块：
(1) 秒计数模块：秒计数，在频率为1Hz的时钟下以60次为循环计数，并产生进位信号影响分计数；
(2) 分计数模块：分计数，在秒进位信号为高电平时，计数一次，同样以60次为一个循环计数，同时产生分进位信号影响时计数；
(3) 时计数模块：时计数，在分进位信号为高电平时，计数一次，以24/12次为一个循环计数；
(4) 频率产生模块：产生8Hz的计数频率 ，通过分频得到1Hz频率；
(5) 时间显示模块：数码管通过动态显示，同时进行一定频率的扫描显示时，分，秒。
(6) 时间设置模块：设置调试使能端，可以调时，分，秒。基本功能是在使能端为高电平时，可以使时和、分和秒循环计数；
(7) 整点报时模块：在秒计数到50秒时，同时分计数到59分开始，蜂鸣器产生四个时钟周期的鸣叫，到整点是产生两个时钟周期的鸣叫。
(8) 闹钟模块：在设定闹钟闹铃时间后，当闹钟使能端有效时，可在闹铃时间闹铃，通过人工拨0后停闹。
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