篇一：数字逻辑电路课程设计实验报告

数字逻辑电路课程设计

---------多功能数字时钟

班级：信息安全1002

姓名：潘祥熙

学号：3100604048

指导老师:袁晓云

时间：20##-6-25

【封面】---------------------------------------------------------------------------- -1-

【目录】----------------------------------------------------------------------------- -2-

【设计目的】---------------------------------------------------------------------- -3-

【设计要求】----------------------------------------------------------------------- -3-

【数字钟的组成和基本工作原理】------------------------------------------- 3~4

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篇二：数字逻辑电路实验报告

数字逻辑电路实验报告

——计数器设计与应用

学院：电信学院

班级：电子72班

姓名：冯天宇

学号：07051042

日期：20##年12月31日

一、实验目的：

1.全面、系统的认识与提高《数字逻辑》课程的学习。

2.熟悉和掌握EDA软件（Quartus II 6.0）设计调试电路的方法。

3.通过实验，提高运用数字逻辑电路解决实际问题的能力，并使学生更深入的理解所学知识。

4. 用D触发器设计同步十六进制加法计数器。

5. 用74LS163（同步清零）设计一个六十进制计数器。

6．用74LS163或74LS190设计24小时制计时器。

二、设计电路及说明：

1. 用D触发器设计同步十六进制加法计数器。

电路如下：

所用器件：2个或门，3个异或门，1个非门，4个D触发器。

同步计数器中，所有触发器的时钟输入端均接受统一计数脉冲并同时产生进位信号，进位信号需要用控制门加以控制。

图中：D₁=/Q₁ D₂=Q₁＋Q₂ D₃=(Q₂·Q₁) ＋Q₃ D₄=(Q₃·Q₂·Q₁) ＋Q₄

从上述D的表达式可以看出，当Q_i-1，Q_i-2，……，Q₁均为1时，再来一个计数脉冲，则产生至第i位触发器的进位信号，Q_i将变反；否则Q_i保持不变。

仿真结果如下：

2. 用74LS163（同步清零）设计一个六十进制计数器:

电路如下：

所用器件：2个与非门，2个74LS163同步计数器。

说明：

74LS163是四位同步二进制加法计数器，同步加载和清零，ENP和ENT为计数使能端。

当给CLK一个脉冲时，左侧的74LS163计数器加1。当它的QD和QA同时为1时，左侧的与非门输出低电压，这正好使低有效的CLRN有效，于是左侧的74LS163清零完成跳跃。每跳跃一次从0-9计数，容易知道左侧的74LS163是十进制计数器。

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篇三：数字逻辑电路实验报告

数字逻辑电路实验报告

实验二：16进制译码器

原理图：

GAL方程：

PLD16V8

BASIC GATES

2009.04.16

LQY USTC V0.1

W X Y Z NC NC NC NC NC GND

NC A B C D E F G NC VCC

/A=/W*/X*/Y*Z+/W*X*/Y*/Z+W*/X*Y*Z+W*X*/Y*Z/

/B=/W*/X*/Y*Z+/W*X*/Y*Z+/W*X*Y*/Z+W*/X*Y*Z+W*X*/Y*/Z+W*X*Y*/Z

/C=/W*/X*/Y*Z+/W*/X*Y*/Z+W*X*/Y*/Z+W*X*Y*/Z+W*X*Y*Z

/D=/W*/X*/Y*Z+/W*X*/Y*/Z+/W*X*Y*Z+W*/X*Y*/Z+W*X*Y*Z

/E=/W*/X*Y*Z+/W*X*/Y*/Z+/W*X*/Y*Z+/W*X*Y*Z+W*/X*/Y*Z

/F=/W*/X*Y*/Z+/W*/X*Y*Z+/W*X*Y*Z+W*X*/Y*Z

/G=/W*/X*/Y*Z+/W*X*Y*Z+W*X*/Y*/Z+/W*/X*/Y*/Z

DESCRIPTION

注释：实验中使用的是共阳极数码管，设计的时候还没有化简

VHDL代码：

LIBRARY IEEE;

USE IEEE.STD_LOGIC_1164.ALL;

ENTITY code16 IS

PORT(w,x,y,z: IN STD_LOGIC;

A,b,c,d,e,f,g:OUT STD_LOGIC

);

END code16;

ARCHITECTURE WORK OF code16 IS

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篇四：数字逻辑电路实验报告模板

《数字逻辑电路》实验报告

第次实验：

姓名：

学号：

级系班

邮箱：

时间：

正文（由下面八项内容评定每次实验报告成绩）

一、实验目的

本次实验预期要学习到的知识、方法等

二、实验原理（背景知识）

本次实验需要的理论知识背景、实验环境和工具等前期准备知识，预习时完成的引导性实验内容一般在此有所体现。

三、实验器材/环境

本次实验中使用的硬件器材和软件环境

四、实验设计思路（验收实验）

验收实验的设计流程图/卡诺图/真值表/代码等或其他

五、实验过程（验收实验的过程）

充分截图，详细说明实验过程步骤等

六、实验结果

简单介绍本次实验完成的工作，学到的知识等。

七、实验中遇到的问题及解决方案

请将已经解决的问题写在这里，没有解决的问题也可以保留在这里，但是可能不能立即得到回答，没有得到回答的问题请在下一次课时向老师和助教当面提问。

八、实验的启示/意见和建议

1 对本课程或本次实验的意见建议等，如：实验内容难度，实验时间安排，如何提高实验效果等。

2 对本次实验内容你有没有让同学更有兴趣的建议，或者如何才能让你对本次实验更有兴趣？

3 你有好的与本次实验有关的实验内容建议吗？比如在日常的学习和生活中遇到的，可以转换为实验的内容？

我们将非常感谢你给我们提出意见和建议，这将使我们的课程更加生动有效。

附：本次实验你总共用了多长时间？包括预习时间、和课堂完成时间。（请大家如实统计，时间长短不影响本次实验的成绩。这个主要用于统计大家的工作时间，粗略确定实验的难度，为我们以后的实验设计提供参考。）

感谢大家的观看和支持！

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篇五：数字逻辑电路实验报告

学院：计算机科学与通信工程

专业：

姓名：

学号：

指导老师：

多功能数字钟

一、设计任务及要求

（1）拥有正常的时、分、秒计时功能。

（2）能利用实验板上的按键实现校时、校分及清零功能。

（3）能利用实验板上的扬声器做整点报时。

（4）闹钟功能

（5）在MAXPLUS II 中采用层次化设计方法进行设计。

（6）在完成全部电路设计后在实验板上下载，验证设计课题的正确性。

二、多功能数字钟的总体设计和顶层原理图

作为根据总体设计框图，可以将整个系统分为六个模块来实现，分别是计时模块、校时模块、整点报时模块、分频模块、动态显示模块及闹钟模块。

（1）计时模块

该模块使用74LS160构成的一个二十四进制和两个六十进制计数器级联，构成数字钟的基本框架。二十四进制计数器用于计时，六十进制计数器用于计分和秒。只要给秒计数器一个1HZ的时钟脉冲，则可以进行正常计时。分计数器以秒计数器的进位作为计数脉冲。

用两个74160连成24进制的计数器，原图及生成的器件如下：

用两个74160连成的60进制计数器，原图及生成的器件如下：

（2）校时模块

校时模块设计要求实现校时，校分以及清零功能。

*按下校时键，小时计数器迅速递增以调至所需要的小时位。

*按下校分键，分计数器迅速递增以调至所需要的分位。

*按下清零键，将秒计数器清零。

注意事项：① 在校分时，分计数器的计数不应对小时位产生影响，因而需要屏蔽此时分计数器的进位信号以防止小时计数器计数。

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篇六：哈工大数字逻辑电路与系统实验报告

Harbin Institute of Technology

数字逻辑电路与系统

课程名称：数字逻辑电路与系统

院系：电子与信息工程学院

班级：

姓名：

学号：

教师： 吴芝路

哈尔滨工业大学

20##年12月

实验二时序逻辑电路的设计与仿真

3.2 同步计数器实验

3.2.1 实验目的

1. 练习使用计数器设计简单的时序电路

2. 熟悉用MAXPLUS II 仿真时序电路的方法

3.2.2 实验预习要求

1. 预习教材《6-3 计数器》

2. 了解本次实验的目的、电路设计要求

3.2.3 实验原理

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篇七：大连海事大学数字逻辑电路课程设计实验总结报告

数字逻辑电路课程设计实验总结报告题目一：用J-K触发器设计13进制加法计数器

一、设计过程：参见设计实验报告（真值表，卡诺图）。二、逻辑电路图：

三、电路图描述：

4个J-K触发器同步接法，每一位J-K触发器的输出端经与非门与灯泡连接（具体c参见设计报告卡诺图下表达式），4个小灯泡代表4位2进制数，左边为高位，右边为低位，小灯泡的亮、灭分别代表“1”，“0”。四、实验结果：

小灯泡由“灭灭灭亮”依次到“亮灭亮灭”，然后到“灭灭灭灭”，代表“0001”依次累加到“1010”然后清零为“0000”，实现0~12，模13加法计数器。

题目二：用74LS194实现M=10序列为1100110101

一、设计过程：参见设计实验报告。二、逻辑电路图：

由74LS194双向移位寄存器产生M=10的1100110101。由Q3,Q2,Q1,Q0代表194四位输出端。灯的亮灭代表10，最右边的灯代表F，即代表所产生的序列。四、实验结果

Q3，Q2，Q1，Q0从“1100”到“1110”成一循环，F的值与之依次对应。参见设计报告真值表。

题目三：用74LS163设计0~98以内的数显电路。

一、设计过程：参见设计实验报告二、逻辑电路图

三、电路描述：

两位74LS163芯片分别代表56进制高地位。低位需要在9即“1001”，以及高位为5（“0101”）、低位为5（“0101”）两个状态清零，通过与非门控制。高位仅在5时（“0101”）时清零。四、实验结果

从“00”开始计数直到“55”清零。

题目四：用74LS163和74LS151设计M=10序列为0011001101序列

一、设计过程：参见设计实验报告二、逻辑电路图

由74LS163,74LS151两个芯片组成。163芯片四位输出端“QD,QC,QB,QA”通过降维（参见设计报告）与151ABC三位输入端项链。151的8位置数端所置的数由降维卡诺图（参见设计报告）确定，从M0到M7分别为：0101‘Q0’111。通过163计数，再由151译码实现所设计序列。四、实验结果：

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